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FPGA通过SRIO发送数据給DSP会呈现链路不稳，	大三 2020-4-8	11677	开心青年 2020-4-8 19:35:54
srio doorbell	若放弃 2020-4-8	01540	若放弃 2020-4-8 19:35:44
ilin vivado时序仿真	开心青年 2020-4-8	11561	若放弃 2020-4-8 19:35:41
求一份aldec alint-pro的资料和软件	常欢 2020-4-8	01425	常欢 2020-4-8 19:35:35
分享Mentor HDL Designer User Manual	常欢 2020-4-8	11492	开心青年 2020-4-8 19:35:32
清华布景-存储器公司，10多年研发经历为何本年才正式成立公司？	大三 2020-4-8	11712	优利卡 2020-4-8 19:35:23
sptartan6 oserdes2输出无信号	若放弃 2020-4-8	11585	853 2020-4-8 19:35:17
20k擺布资源的FPGA大概啥价格？	常欢 2020-4-8	11326	常欢 2020-4-8 19:35:11
aurora 8b10b	大三 2020-4-8	11520	若放弃 2020-4-8 19:35:05
(Kluwer) Verilog Quickstart	开心青年 2020-4-8	11386	常欢 2020-4-8 19:34:59
srio學习笔记，FPGA与DSP之间的SRIO通信。	开心青年 2020-4-8	11698	常欢 2020-4-8 19:34:53
关于亚稳态恢复到稳态的问题	开心青年 2020-4-8	01650	开心青年 2020-4-8 19:34:44
行為仿真究竟有没有时延	常欢 2020-4-8	11638	常欢 2020-4-8 19:34:41
請教PWM的占空比	若放弃 2020-4-8	01285	若放弃 2020-4-8 19:34:35
高阶viterbi decoder 中的‘高阶’ 到底指的是什么意思？	开心青年 2020-4-8	11522	大三 2020-4-8 19:34:26
VERILOGIN的问题	853 2020-4-8	11360	常欢 2020-4-8 19:34:19
Delay只有兩种實现方式？	若放弃 2020-4-8	11178	若放弃 2020-4-8 19:34:13
北京-海淀區急招SOC設计、验证（技术氛圍好，大牛多）	若放弃 2020-4-8	11407	开心青年 2020-4-8 19:34:05
跪求一段基于Verilog语言配置AD芯片寄存器的程序。。。。。。	853 2020-4-8	11375	大三 2020-4-8 19:33:59
XILINX Kinte-7 XC7K70T应该用什么配置芯片？	开心青年 2020-4-8	11256	若放弃 2020-4-8 19:33:53
好奇Video的SOC，还有其他类的多媒体SOC或者IP主要是实现什么功能呢？	若放弃 2020-4-8	01200	若放弃 2020-4-8 19:33:46
初学者关于电路竞争的问题求助	大三 2020-4-8	01219	大三 2020-4-8 19:33:37
深圳，上海，南京等地招聘芯片研发类岗位，欢迎咨询	常欢 2020-4-8	01282	常欢 2020-4-8 19:33:34
請問有 standard cell Lib之後, 要怎麼插手DC ?	优利卡 2020-4-8	01212	优利卡 2020-4-8 19:33:21
请问双向IO PAD中的使能端应该怎么连接	大三 2020-4-8	01229	大三 2020-4-8 19:33:14
双击ise工程中的IP核为什么打不开IP核的编纂界面	若放弃 2020-3-9	01199	若放弃 2020-3-9 16:57:14
关于FPGA显示波形的问題	若放弃 2020-3-9	11394	853 2020-3-9 16:57:11
关于前端设計中资源使用情况	大三 2020-3-9	11314	若放弃 2020-3-9 16:57:05
corte M0 eval版本能用于silicon吗？	常欢 2020-3-9	11331	开心青年 2020-3-9 16:56:51
PT report timing DFF的 CDN到下一个 DFF的 D端	开心青年 2020-3-9	11249	大三 2020-3-9 16:56:45
fpga IP core license 讨论	常欢 2020-3-9	01103	常欢 2020-3-9 16:56:39
DDR2突发问題	常欢 2020-3-9	01107	常欢 2020-3-9 16:56:33

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