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SystemVerilog中的隨机化问题 [复制链接]

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楼主
发表于 2020-4-8 19:39:16 |只看该作者 |倒序浏览
欢迎来到九江论坛网--江西九江市生活交流社区! 请记住我们的网址 www.ganzw.com
请问Systemverilog中的rand 和 randc都只能在class中用吗?如果不在class中怎么用?我直接

rand bit [12:0] x;
always #30 x.randomize();

这样行吗?

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沙发
发表于 2020-4-8 19:39:19 |只看该作者
欢迎来到九江论坛网--江西九江市生活交流社区! 请记住我们的网址 www.ganzw.com
应该是randomize(x)这么用。因为它不是一个对象,而只是一个属性。

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